職位描述： 1.各種IP的模塊驗(yàn)證，SOC相關(guān)的集成驗(yàn)證、系統(tǒng)驗(yàn)證，負(fù)責(zé)驗(yàn)證計(jì)劃的制定實(shí)施、測(cè)試用例的編寫(xiě)。 2.先進(jìn)驗(yàn)證方法和驗(yàn)證平臺(tái)的評(píng)估、導(dǎo)入 高級(jí)驗(yàn)證或leader另外要求： 1.負(fù)責(zé)整個(gè)團(tuán)隊(duì)驗(yàn)證平臺(tái)的搭建、維護(hù)，能夠帶領(lǐng)團(tuán)隊(duì) 2.先進(jìn)驗(yàn)證方法和驗(yàn)證平臺(tái)的評(píng)估、導(dǎo)入 3.良好的溝通能力，英文溝通流暢 崗位要求： 1.大學(xué)本科及以上學(xué)歷，電子、通信、計(jì)算機(jī)或微電子專業(yè) 2.高級(jí)驗(yàn)證或leader至少三年芯片驗(yàn)證的相關(guān)工作經(jīng)驗(yàn) 3.熟悉verilog、System verilog、 C/C ，有扎實(shí)的數(shù)字電路基礎(chǔ) 4.熟悉SOC驗(yàn)證開(kāi)發(fā)流程，了解常用的驗(yàn)證方法學(xué)，如UVM等 5.熟悉linux/unix環(huán)境，掌握per/python和unix shell語(yǔ)言 Job Description： 1.Take charge of verification platform development, and maintenance the plaform. 2.Familiar with verification methodologies and developing the platform. 3.Knowledge about IP block verfication, SOC integrated verification,system verification.Take charge of planning and pushing the team work of verification.Enable to write the Test Bench. The staff or manager needs as below: 1.Take charge of verification platform development, and maintenance the platform. Can lead the team. At least 3 years of work experience. 2.Familiar with verification methodologies and developing the platform. 3.Knowledge about IP block verfication, SOC integrated verification,system verification.Take charge of planning and pushing the team work of verification.Enable to write the Test Bench. 4.Good communication ability and good spoken English. Requirements: 1.Majors in Electronics,Telecommunication,Computer or Micro Electronics.Bachelor or above degree. 2.The staff or manager must have above 3 year Design Verification experience. 3.Familiar with verilog,System verilog,C/C ,rich knowledge about the digital circuit. 4.Familiar with SOC design verfication flow.Know about the verification methodologies,such as VMM etc. 5.Familiar with Linux/Unix,know about perl,python and unix shell.
譚飛鴻
職責(zé): 1. 在模塊/子系統(tǒng)/芯片級(jí)別驗(yàn)證設(shè)計(jì)和實(shí)現(xiàn)； 2. 根據(jù)規(guī)范確定驗(yàn)證范圍，制定驗(yàn)證計(jì)劃/目標(biāo)； 3.使用隨機(jī)驗(yàn)證方法(如UVM)的測(cè)試平臺(tái)開(kāi)發(fā)，測(cè)試用例開(kāi)發(fā)； 4. 與建筑師，設(shè)計(jì)師和物理設(shè)計(jì)(布局)合作實(shí)施。 5. 使用gate-level netlist進(jìn)行后期模擬。 6. 支持前/后硅測(cè)試。 要求: 1. 微電子、電子工程或相關(guān)專業(yè)本科、碩士或博士，2年以上認(rèn)證工作經(jīng)驗(yàn)； 2. 經(jīng)驗(yàn)System-Verilog / UVM OVM / VMM / Specman-E； 3.熟悉模擬器(Modelsim, NC-sim, VCS)； 4. 有Perl或其他腳本語(yǔ)言的使用經(jīng)驗(yàn)； 5. 熟悉2G/3G/4G/5G基帶架構(gòu)，ARM, AHB架構(gòu)優(yōu)先； 6. 熟悉基帶芯片外設(shè)(PCIE/USB/MIPI/I2C)優(yōu)先； 7. 英語(yǔ)良好。
任志軍
職位描述：1.負(fù)責(zé)整個(gè)團(tuán)隊(duì)驗(yàn)證平臺(tái)的搭建、維護(hù)2.先進(jìn)驗(yàn)證方法和驗(yàn)證平臺(tái)的評(píng)估、導(dǎo)入3.各種IP的模塊驗(yàn)證，SOC相關(guān)的集成驗(yàn)證、系統(tǒng)驗(yàn)證，負(fù)責(zé)驗(yàn)證計(jì)劃的制定實(shí)施、測(cè)試用例的編寫(xiě)。
譚飛鴻
崗位職責(zé)： 1. 負(fù)責(zé)維護(hù)現(xiàn)有的驗(yàn)證環(huán)境，負(fù)責(zé)開(kāi)發(fā)重用性的驗(yàn)證策略，測(cè)試計(jì)劃，測(cè)試樣例的開(kāi)發(fā)； 2. 負(fù)責(zé)搭建soc芯片驗(yàn)證環(huán)境，負(fù)責(zé)SOC和IP驗(yàn)證； 3. 負(fù)責(zé)開(kāi)發(fā)應(yīng)用樣例，確保soc芯片功能和性能的正確率； 4. 負(fù)責(zé)覆蓋率驗(yàn)證分析； 5. 負(fù)責(zé)撰寫(xiě)芯片測(cè)試計(jì)劃，包括前仿和后仿； 6. 負(fù)責(zé)設(shè)計(jì)測(cè)試方案，協(xié)助對(duì)芯片樣片進(jìn)行測(cè)試評(píng)估，確保達(dá)到電路設(shè)計(jì)要求。 任職資格： 1. 電子工程、計(jì)算機(jī)科學(xué)、微電子學(xué)等相關(guān)專業(yè)本科及其以上學(xué)歷，熟練閱讀英文資料能力，3年以上驗(yàn)證工作經(jīng)驗(yàn)； 2. 熟悉規(guī)格定義到量產(chǎn)完整的SoC芯片的開(kāi)發(fā)流程及相關(guān)EDA工具； 3. 熟悉NC-Verilog System Verilog 等開(kāi)發(fā)測(cè)試testbench 和 case 經(jīng)驗(yàn)； 4. 熟悉測(cè)試覆蓋率、門(mén)級(jí)后仿、 測(cè)試pattern 生成和調(diào)式經(jīng)驗(yàn)； 5. 具備一種或幾種腳本語(yǔ)言（TCL/Perl）開(kāi)發(fā)能力，自動(dòng)生成測(cè)試code； 6. 具備SOC/MCU、AMBA總線、UART/SPI/I2C等通用低速接口工作經(jīng)驗(yàn)為佳； 7. 了解后端 FPGA flow、具有嵌入式軟件調(diào)試為佳。 8. 良好的敬業(yè)、團(tuán)隊(duì)合作精神以及溝通能力，做事踏實(shí)、認(rèn)真、勤懇。
陸健
崗位職責(zé)：1、 ASIC到FPGA的修改和集成2、 編寫(xiě)測(cè)試用例以驗(yàn)證FPGA SOC原型3、 使用Synopsys、Xilinx工具進(jìn)行FPGA/EMU合成、分區(qū)和仿真4、 FPGA原型系統(tǒng)調(diào)試與實(shí)現(xiàn)5、 任務(wù)自動(dòng)化的腳本工作6、 支持FPGA仿真、實(shí)驗(yàn)室驗(yàn)證和調(diào)試；任職資格：1、 電氣/電子工程學(xué)士，理學(xué)碩士?jī)?yōu)先；2、 3-5年的專業(yè)經(jīng)驗(yàn)；3、 熟悉FPGA經(jīng)驗(yàn)，包括實(shí)現(xiàn)、合成（Synplify）、定時(shí)關(guān)閉（維瓦多/ISE）4、 熟悉典型的FPGA/EMU改進(jìn)平臺(tái)，如Xilinx、Altera、Haps、Palladium等5、 具有無(wú)線網(wǎng)絡(luò)協(xié)議、無(wú)線通信和音頻處理方面的經(jīng)驗(yàn)和知識(shí)6、 有FPGA PCB或嵌入式軟件經(jīng)驗(yàn)者優(yōu)先；7、 有高速接口（如PCIE和DDR）方面的經(jīng)驗(yàn)和知識(shí)者優(yōu)先；8、 有SOC設(shè)計(jì)和外圍設(shè)備設(shè)計(jì)經(jīng)驗(yàn)和知識(shí)，如AHB、APB、UART、I2C、I3C優(yōu)先9、 有自動(dòng)代碼生成和Perl、Python和Unix Shell經(jīng)驗(yàn)者優(yōu)先。職位亮點(diǎn)：國(guó)內(nèi)高端芯片企業(yè)，專注技術(shù)研發(fā)
殷子熙/人才顧問(wèn)
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